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Verilog代码在quartus II中进行时序仿真，但输出出现延时，该如何解决？
Verilog代码在quartus II中进行时序仿真，但输出出现延时，该如何解决？
2024年11月16日 09:32
有1个网友回答
网友（1）：
时序仿真就是查看时序信息的吗，包括延时时间等。。。
不明白你什么意思？
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