集成电路设计，是做什么的。

集成电路设计涉及对电子器件（例如晶体管、电阻器、电容器等）、器件间互连线模型的建立。所有的器件和互连线都需安置在一块半导体衬底材料之上，这些组件通过半导体器件制造工艺（例如光刻等）安置在单一的硅衬底上，从而形成电路。

集成电路设计最常使用的衬底材料是硅。设计人员会使用技术手段将硅衬底上各个器件之间相互电隔离，以控制整个芯片上各个器件之间的导电性能。

扩展资料

集成电路设计通常是以“模块”作为设计的单位的。例如，对于多位全加器来说，其次级模块是一位的加法器，而加法器又是由下一级的与门、非门模块构成，与、非门最终可以分解为更低抽象级的CMOS器件。

从抽象级别来说，数字集成电路设计可以是自顶向下的，即先定义了系统最高逻辑层次的功能模块，根据顶层模块的需求来定义子模块，然后逐层继续分解；设计也可以是自底向上的。

参考资料来源：百度百科-集成电路设计

集成电路设计就是设计出来集成电路的整个规范，电子元件摆放等工作。

主要内容包括集成电路的材料、制造工艺和器件模型、集成电路模拟软件SPICE的基本用法、集成电路版图设计、模拟集成电路基本单元、数字集成电路基本单元、集成电路数字系统设计和集成电路的测试与封装等。

hi，我是集成电路专业的，本科是，硕士也是，这个专业其实和微电子差不多，但更偏重电路设计与应用，微电子就包括半导体材料，半导体器件，集成电路设计。集成电路设计包括模拟与数字，模拟就看看拉扎维那本书，数字主要用数字描述语言写代码。 分拿来。哈哈

1.数字电路研发工具及开发软件.
步骤1.
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确认逻辑功能时采用的工具是FPGA板及Altera公司Quartus工具软件及Mentor公司的ModelSim做功能仿真寻找错误
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2.在上述工作确认完后使用Synopsys公司推出的Design Compiler(简称DC),转出逻辑电路的连接关系及Verilog的门级连接代码.
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步骤3.
用Synopsys公司推出的Primetime(简称PT)做静态时序分析,其目的在于寻找时序延误带来的错误及违备时序约束的错误.
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步骤4.用Cadence公司的Encounter软件完成数字电路的布局怖线版图设计(Auto Placement&Route),自动布局布线软件,用上述DC工具所转出的Verilog网表导入到Encounter软件后设置芯片怖局的物理约束,其物理约束的规则是由晶圆代工厂所提供,此一步骤完成后由仿真电路设计者及仿真电路布局者将此文件进行模数版图整合.
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2.模拟电路仿真及版图设计工具及流程
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步骤1.利用Cadence公司推出的 Virtuoso软件将原理图绘出.
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步骤2.利用Cadence公司推出的MMSIM中的ADE(Analog Design Environment)做仿真电路前仿真.
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步骤3.将已设计完的仿真电路连同已自动布局布线后的数字电路版图用Virtuoso中的Layout plus软件做数模拼接的版图设计.
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步骤4.用Mentor公司推出的Calibre公具做LVS跟DRC及用Layout plus工具做寄生参数提取后在用步骤2的ADE软件,做模数整合版图的后仿真,重复此动做直到芯片仿真结果达到规格的要求便可开掩膜进行流片动做.