请教verilog 怎么调用VHDL,

2024年11月27日 14:52
有2个网友回答
网友(1):

一样的调用,我们大学学的都是VHDL
tas moduel_name

.reset(),
.clk(),
.data(),
.flag(),
.up()
);
注晌棚意前面的“点”,和后面的“宴运则逗号”
基本主流的软悄饥件都会编译通过

网友(2):

和调用VERILOG模块是一样的 主流的编译器是支持这种方法的